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設計データの検証時間短縮とは?課題と対策・製品を解説

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回路・パターン設計における設計データの検証時間短縮とは?
半導体設計において、回路図やレイアウトといった設計データの正確性を保証するための検証プロセスは不可欠です。しかし、設計の複雑化に伴い、この検証に要する時間が長期化する傾向にあり ます。本テーマでは、この検証時間の短縮を目指す取り組みについて解説します。目的は、製品開発サイクルの迅速化、コスト削減、そして市場投入までのリードタイム短縮を実現することです。
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【電子機器向け】発泡スチロール箱 プロダクトカタログ
増幅機能付き光ハブ装置
1、特徴と応用
・多入力多出力の光ハブ装置において、その光挿入損失補償するために半導体増幅器SOAを
内蔵した増幅機能付き光ハブ装置SOA-HUBです。
・光の伝送路には、光スプリッタや光カプラ—が良く利用されますが、
その接続ごとに光損失を生じます。とくに、光ハブは、入力側の光カプラおよび
出力側の光スプリッターで損失があり、このような損失補償にSOAが便利に利用できます。
2機能
・長波長帯のCWDM光源からの1.5μm帯の光を10dB以上増幅する機能を有するSOAを光ハブ装置に
内装することにより、損失の補償された構成の小型の光ハブ装置ができます。
・SOAの特性の詳細は、SOAのカタログをご参照ください。
※詳細は資料請求まで
超高速アナログ入力・信号処理ボード『UAP6200N』
『UAP6200N』は、高速データ処理用にFPGAを2個搭載している
8Bit、6Gsps 2channel + FPGA ボードです。
データ出力FPGA(Virtex-4)から、6Gbps(実効速度)の高速シリアル出力
4チャネル装備していますので、最大24Gbps までのデータ出力が可能。
また、FPGA での入出力(特に、超高速アナログ入信号処理)につきましては
標準のIP ライブラリィが用意されています。これにより、ユーザは
信号処理部分の実装に専念する事ができます。
【特長】
■広帯域アナログデータサンプリング 6Gsps 8Bits 2Ch
■高速データ処理用にFPGA 2個搭載
・Virtex5:高速信号処理
・Virtex4:データ出力用
■高速シリアル出力をサポート
・3Gbps(Max.):4出力、4入力
・6Gbps(Max.):4出力
※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせください。
CMOS 32Gb/s パルスパターンジェネレータ
当社では、Atilia Technology社製『CMOS 32Gb/s パルスパターンジェネレータ』を
取り扱っております。
本パルスパターン発生器(PPG)「P1」は、CMOSベース32Gb/s、またそれ以上の
ビットレートまで高い品質の作動出力データを提供します。
外部ハーフレート方式(すなわち32Gb/sデータの場合、16GHzのクロックインプット)
によって駆動し、27-1、215-1、223-1、231-1の疑似ランダムパターン(PRBS)を
出力できると共に10-3、10-6、10-9及び0の エラーを挿入できます。
【特長】
■高性能
■コンパクトで低価格
■独立したパルスパターン設定
■最大60psのスキュー設定が可能
■2ch、4chタイプもご用意
※英語版カタログをダウンロードいただけます。
※詳しくはPDF資料をご覧いただくか、お気軽にお問い合わせ下さい。
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